교육일정/신청 – HLS2019-02-28T10:31:02+09:00

Education Center

2019년 12월

교육 카테고리:

HLS

12dec(dec 12)10:00 am13(dec 13)5:00 pmVivado® HLS를 이용한 C/C++ 기반의 FPGA 설계Vivado® HLS를 이용한 C/C++ 기반의 FPGA 설계

26dec(dec 26)10:00 am27(dec 27)5:00 pmVivado® HLS를 이용한 C/C++ 기반의 FPGA 설계Vivado® HLS를 이용한 C/C++ 기반의 FPGA 설계

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12dec(dec 12)10:00 am135:00 pmVivado® HLS를 이용한 C/C++ 기반의 FPGA 설계Vivado® HLS를 이용한 C/C++ 기반의 FPGA 설계

강의기간

2019년 12월 12일~12월 13일(2일간)

Time

12 (Thursday) 10:00 am - 13 (Friday) 5:00 pm

교육장소

당산 리버트론 IT 교육센터(리버트론 홈페이지 참조)

교육비

700,000원 (VAT 포함)

주관(강사)

김민석

진행여부

신청마감

교육분류

ATP 교육

수준

초/중급

교육대상

C, C++등을 이용하여 FPGA를 설계하고자 하는 H/W 또는 S/W 설계자

수강신청

신청마감

Education Details

 

◆ 교육명

 Vivado® HLS를 이용한 C/C++ 기반의 FPGA 설계

 

 

◆ 교육 대상

C 및 FPGA 사용 경험이 있는 H/W 또는 S/W 설계자

 

 

◆ 교육 과정

Software Tool : Vivado® HLS

Textbook : C-based Design High-Level Synthesis with Vivado HLx

 

 

◆ 교육 목표

Vivado® HLS 사용 Flow 이해 및 FPGA에 적용 이해

Vivado® HLS 이용 사용 목적에 맞는 옵션 이해

디자인 블록의 인터페이스 이해를 통한 디자인 구성

 

 

◆ 강의 개요

본 강의는 C기반의 코드를 Vivado® HLS 소프트웨어를 이용하여 FPGA로 적용 가능한 HDL로 전환하는 내용을 이해하는 수업입니다.
순차 구조의 C 코드를 병렬 구조의 HDL 형태로 변환하기 위한 개념과 퍼포먼스 향상을 위한 Language 전환 옵션의 이론과 실습을 진행합니다.
그리고 검증을 위한 C 코드 또는 변환된 RTL을 이용한 Simulation과 사용 인터페이스의 블록 이해를 기반한 인터페이스 구성에 대해 알아보고 실습합니다.

 

 

이론 실습

1일차

  • Vivado HLS 소개
  • Vivado HLS Flow 이해
  • Vivado HLS 커맨드라인 인터페이스 이해
  • Vivado HLS이용 latency 최적화
  • Vivado HLS Flow 이해 및 구성 실습
  • Vivado HLS CLI Flow 이해 및 실습
  • Unrolling 최적화 구성 실습

2일차

  • Vivado HLS의 Throughput 최적화
  • Vivado HLS의 배열 최적화
  • Vivado HLS의 Area 최적화
  • Vivado HLS의 C코드 이해
  • Throughput 최적화 구성 실습
  • Memory 최적화 구성 실습
  • 시스템 통합 구성 실습
  • 행렬 곱셈 구성 실습

 

 

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